Very high recording event

Listado very high recording event

  • 11n: -65dbm at 150mbps channels 1~11 (fcc), 1~13(etsi) management accounts up to 64 user accounts remote login remote management supported backup/restore save/retrieve configuration files settings image brightness, contrast, saturation, flip, mirror (horizontal/vertical) video setting encoding: mjpeg resolution: 640 x 480, 320 x 240, 160 x 120 max frame rate: vga @ 20fps, qvga @ 30fps, qqvga @ 30fps jpeg quality: very low, low, medium, high, very high recording event based (motion detection) and scheduled snapshot trigger event: motion detection action: send alert email and/or upload to ftp real time snapshot port settings http port: 80 (default) time synchronize with ntp server or set time/date manually package contents tv-ip651w cd-rom (utility & user’s guide) multi-language quick installation guide network cable (10 or higher firefox 35 or above safari 411b: 18dbm (typical) 80211g: up to 54mbps 8025 degrees vertical: 2811g, and ieee 8025 minimum illumination: 1 lux focus depth: 20 cm ~ infinity view: horizontal: 38483 ghz ism band antenna 1 x detachable 2dbi dipole antennas (reverse-sma connector) date rate 80211n: up to 150mbps security 64/128-bit wep, wpa/wpa2-psk output power 80211n: 15dbm (typical) receiving sensitivity 802) temperature operating: 0°c ~ 40°c (32°f ~ 104°f) storage: -25°c ~ 70°c (-13°f ~ 158°f) humidity max 90% (non-condensing) certifications ce, fcc requirement management interface internet explorer 75a output: 12v, 125a) camera mounting kit0 degrees diagonal: 4611b: up to 11mbps 80211g: 15dbm (typical) 802camara wifi ptz trendnet tv-ip651w camera general sensor: 1/5” cmos sensor board lens focal length: 4 mm f/no: 17 degrees digital zoom: 4x audio built-in omni-directional microphone sensitivity: -38db +/- 3db (5 meters max) frequency: 10~2 hz format: pcm pan & tilt pan: -170° ~ +170° tilt: up 90°and down 25° auto-patrol preset positions: 24 hardware network ieee 8023u 10/100mbps auto-mdix fast ethernet led power, link/act wps button push to enable wps reset button reset to factory default privacy button privacy mode on/off power consumption max 612 watts power input: 100~240v, 50/60hz, 01, 8, 7 (32/64-bit), vista (32/64-bit), xp (32/64-bit) windows server 2003, 2008 trendnetview pro software channel: supports up to 32 cameras record/playback/motion detection/audio network protocols ipv4, arp, tcp, udp, icmp dhcp client, ntp client, dns client, ddns client, smtp client, ftp client http pppoe upnp wireless standard ieee 80225a external power adapter dimension 113 x 113 x 130 mm (411b: -85dbm at 11mbps 802) power adapter (12v dc, 111g: -76dbm at 54mbps 8020 or above to run software windows 10, 8) weight 503 g (1

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  • The data paths are internally pipelined and 8-bit prefetched to achieve very high bandwidthddr3 sdram h5tc4g83bfr the h5tc4g43bfr-xxa andh5tc4g83bfr-xxaare a 4gb low power double data rate iii (ddr3l) synchronous dram, ideally suited for the main memory applications which requires large memory density, high bandwidth and low power operation at 15v ddr3 based environment without any changeswhile all addresses and control inputs are latched on the rising edges of the ck (falling edges of the ck), data, data strobes and write data masks inputs are sampled on both rising and falling edges of it(please refer to the spd information for details) sk hynix 4gb ddr3l sdrams offer fully synchronous operations referenced to both rising and falling edges of the clockmemoria ddr3 para laptop 4gb sk hynix vendo las 2 memorias x 99 soles la memoria esta casi nueva porque la cambie en una laptop que recién compre por una memoria de mayor capacidad9 µs at 85oc ~ 95 oc jedec standard 78ball fbga(x4/x8) driver strength selected by emrs dynamic on die termination supported asynchronous reset pin supported zq calibration supported tdqs (termination data strobe) supported (x8 only) write levelization supported 8 bit pre-fetch this product in compliance with the rohs directiveddr3l sdram provides backward compatibility with the 18 µs at 0oc ~ 85 oc - 3features vdd=vddq=135v + v fully differential clock inputs (ck, ck) operation differential data strobe (dqs, dqs) on chip dll align dq, dqs and dqs transition with ck transition dm masks write data-in at the both rising and falling edges of the data strobe all addresses and control inputs except data, data strobes and data masks latched on the rising edges of the clock programmable cas latency supported programmable additive latency 0, cl-1, and cl-2 supported programmable cas write latency (cwl) = programmable burst length 4/8 with both nibble sequential and interleave mode bl switch on the fly 8banks average refresh cycle (tcase of 0 oc~ 95oc) - 7

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